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5mW待機(jī)功耗突圍戰(zhàn)!AC-DC電源待機(jī)功耗逼近物理極限

發(fā)布時間:2025-04-29 責(zé)任編輯:lina

【導(dǎo)讀】在全球節(jié)能減排趨勢下,降低電子設(shè)備的待機(jī)功耗成為技術(shù)攻堅的核心課題。AC-DC電源作為電力轉(zhuǎn)換的關(guān)鍵環(huán)節(jié),其待機(jī)功耗直接影響著能源浪費水平。本文深入解析如何通過初級側(cè)調(diào)節(jié)反激式拓?fù)?、智能控制策略及器件?yōu)化,實現(xiàn)待機(jī)功率低于5mW甚至趨近于零的技術(shù)路徑。

 

在全球節(jié)能減排趨勢下,降低電子設(shè)備的待機(jī)功耗成為技術(shù)攻堅的核心課題。AC-DC電源作為電力轉(zhuǎn)換的關(guān)鍵環(huán)節(jié),其待機(jī)功耗直接影響著能源浪費水平。本文深入解析如何通過初級側(cè)調(diào)節(jié)反激式拓?fù)?、智能控制策略及器件?yōu)化,實現(xiàn)待機(jī)功率低于5mW甚至趨近于零的技術(shù)路徑。


反激式拓?fù)洌旱凸脑O(shè)計的基石


反激式拓?fù)鋺{借結(jié)構(gòu)簡單、成本低廉的優(yōu)勢,成為低功耗離線電源的首選方案。傳統(tǒng)設(shè)計中,光耦器件用于次級側(cè)電壓反饋,但其功耗與穩(wěn)定性問題逐漸顯露?,F(xiàn)代準(zhǔn)諧振(QR)反激式控制器通過初級側(cè)調(diào)節(jié)技術(shù),徹底摒棄光耦依賴——利用變壓器偏置繞組的磁反饋形成閉環(huán)控制,僅需電阻分壓網(wǎng)絡(luò)即可精準(zhǔn)調(diào)節(jié)輸出電壓。以德州儀器UCC28710控制器為例(圖1),其通過檢測諧振谷值電壓實現(xiàn)軟開關(guān),將開關(guān)損耗降低40%以上。


5mW待機(jī)功耗突圍戰(zhàn)!AC-DC電源待機(jī)功耗逼近物理極限

圖1:基于UCC28710的初級側(cè)穩(wěn)壓反激式架構(gòu)


準(zhǔn)諧振技術(shù)的核心在于利用電路寄生參數(shù)(初級電感與開關(guān)節(jié)點電容)產(chǎn)生的諧振特性。如圖2所示,當(dāng)次級電流歸零后,控制器在諧振電壓谷底觸發(fā)MOSFET導(dǎo)通,使開關(guān)節(jié)點電壓從400V降至50V以下,顯著減少開關(guān)過程中的能量損耗。這種“谷底開關(guān)”機(jī)制,可將轉(zhuǎn)換效率提升至88%以上。


5mW待機(jī)功耗突圍戰(zhàn)!AC-DC電源待機(jī)功耗逼近物理極限

圖2:谷底開關(guān)顯著降低電壓應(yīng)力(Vds為MOSFET漏源電壓)


待機(jī)功耗構(gòu)成與優(yōu)化路徑


實現(xiàn)極低待機(jī)功耗需系統(tǒng)化解決三大能量損耗源:


1. 周期性能量損耗


每個開關(guān)周期從輸入源獲取的能量(E_cycle)直接決定待機(jī)功耗水平。其計算公式為:


E_{cycle} = 0.5 \times C_{oss} \times V_{bulk}^2 \times f_{sw}  


其中,C_oss為MOSFET輸出電容,V_bulk為母線電壓,f_sw為開關(guān)頻率。通過將開關(guān)頻率降至10kHz以下,UCC28710在空載時的周期損耗可控制在3mW以內(nèi)。但低頻運行會惡化瞬態(tài)響應(yīng)——當(dāng)負(fù)載突變時,控制器需長達(dá)100ms才能檢測到電壓波動。


2. 啟動電路革新


傳統(tǒng)電阻啟動方案在230VAC輸入時產(chǎn)生超過200mW損耗,成為待機(jī)功耗的主要短板。革新方案采用耗盡型MOSFET構(gòu)建有源啟動電路:

  • 上電初期,F(xiàn)ET導(dǎo)通為控制器供電

  • 輸出電壓建立后,F(xiàn)ET被關(guān)斷
    該設(shè)計使啟動損耗從毫瓦級降至微瓦級,配合UCC28710的自適應(yīng)供電系統(tǒng),整體待機(jī)損耗減少60%。


3. 緩沖網(wǎng)絡(luò)與寄生參數(shù)治理


  • TVS緩沖替代RCD網(wǎng)絡(luò):瞬態(tài)電壓抑制二極管(TVS)在電壓超過箝位值前幾乎無損耗,較傳統(tǒng)RCD方案效率提升5%

  • 超快恢復(fù)二極管選擇:反向恢復(fù)時間<35ns的二極管可減少開關(guān)節(jié)點震蕩損耗

  • 寄生電容壓縮:通過優(yōu)化PCB布局與選用低C_oss MOSFET(如Infineon IPA60R280P7),將開關(guān)節(jié)點總電容控制在150pF以內(nèi)


零待機(jī)功耗的終極方案


突破5mW待機(jī)功耗壁壘需要顛覆性技術(shù)創(chuàng)新。德州儀器推出的UCC28730+UCC24650芯片組,通過“超低頻運行+智能喚醒”機(jī)制實現(xiàn)革命性突破:


關(guān)鍵技術(shù)突破

  • 32Hz超低頻模式:空載時開關(guān)頻率降至32Hz,周期損耗僅0.8mW

  • 跨隔離柵喚醒技術(shù):次級側(cè)UCC24650實時監(jiān)測輸出電壓,當(dāng)負(fù)載接入導(dǎo)致電壓下降3%時,通過變壓器耦合發(fā)送喚醒信號

  • 三脈沖加速響應(yīng):初級側(cè)控制器收到信號后,立即以65kHz頻率發(fā)送三個脈沖,在10ms內(nèi)恢復(fù)穩(wěn)壓輸出


性能對比


5mW待機(jī)功耗突圍戰(zhàn)!AC-DC電源待機(jī)功耗逼近物理極限


工程實踐挑戰(zhàn)與對策


在實際設(shè)計中,工程師需平衡多項矛盾因素:


瞬態(tài)響應(yīng)與功耗的博弈

  • 預(yù)負(fù)載策略:在輸出端添加10kΩ電阻(損耗5mW)可改善動態(tài)性能,但會增加待機(jī)功耗

  • 自適應(yīng)頻率調(diào)制:根據(jù)負(fù)載情況動態(tài)調(diào)整開關(guān)頻率,輕載時運行于10kHz,重載時升至130kHz


器件選型準(zhǔn)則

  • MOSFET:優(yōu)選C_oss<100pF、Rds(on)<0.3Ω的CoolMOS(如STF10N65M5)

  • 變壓器:采用TDK PC40材質(zhì),漏感控制在2%以內(nèi)

  • 輸出二極管:超快恢復(fù)類型(如ONSemi MUR160),反向恢復(fù)時間<50ns


熱管理設(shè)計

  • 在85℃環(huán)境溫度下,需確保啟動MOSFET結(jié)溫<110℃

  • 使用3M導(dǎo)熱膠將控制器與PCB銅箔區(qū)域緊密貼合,熱阻降至15℃/W


行業(yè)應(yīng)用與未來展望


目前,該技術(shù)已在智能手機(jī)充電器(如小米120W快充)、智能家居網(wǎng)關(guān)等場景實現(xiàn)商用。歐盟ErP指令要求2026年后所有外置電源待機(jī)功耗<5mW,這將推動相關(guān)方案快速普及。未來,隨著GaN器件與數(shù)字控制技術(shù)的融合,AC-DC電源有望在保持零待機(jī)損耗的同時,將功率密度提升至30W/in3,為能源革命注入新動能。


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